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特点
可再编程闪存技术
0.22米4 LM滚动基于闪存的CMOS工艺
内部和/或外部的PLL动态配置
两个时钟或数据的LVPECL差分对输入
标准的FPGA和ASIC设计流程
灵活性与工业标准的前端工具的选择高效的设计,通过前端定时和门优化ISP支持
在系统编程(ISP通过JTAG端口)
静态存储器和FIFO
的SmartGen网表生成确保了最佳的使用情况
嵌入式存储器块
24 SRAM和同步FIFO的配置,并异步运行到150兆赫(典型)
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