登录站点

用户名

密码

按照发布时间排序
  • Title Why are the "mem_clk's" in our ALTMEMPHY and High Performance (HP) Memory controllers assigned as INOUT / Bidirectional signals, when of course they are actually just outputs? Description The "mem_clk's" in our HDL are set as INOUT / Bidirectional si
    170 次阅读|没有评论
  • 129 次阅读|没有评论
  • 分享

    about 集群通信

    刘宝 2012-04-25 18:39
    集群通信系统是按照动态信道指配的方式实现多用户共享多信道的无线电移动通信系统。该系统一般由终端设备、基站和中心控制站等组成,具有调度、群呼、优先呼、虚拟专用网、漫游等功能。
    201 次阅读|没有评论
  • 分享

    about IBIS

    刘宝 2012-04-20 22:32
    IBIS(Input/Output Buffer Information Specification)模型是一种基于V/I 曲线 的对I/O BUFFER 快速准 确建模的方法,是反映芯片驱动和接收电气特性的一种国际标准,提供一种标准的 文件格式 来记录如驱动源输出阻抗、上升/下降时间及输入负载等参数,非常适合做振荡和串扰等高频效应的计算与仿真。 编写组
    142 次阅读|没有评论
  • verilog中无默认的timescale,如果在testbench中未添加timescale,则使用的是上一次编译时的timescale参数。。。
    88 次阅读|没有评论
  • 今天与同事聊起了 IC 工程师的修养等问题,结合不久前的一个想法,总结成文,抛砖引玉,欢迎讨论和补充,转载请注明。 RTL 语言 仅仅就是 Diablo 里面女巫的火球。。。是首个技能,但你升到 20 级也就是个火球。。。当然对别的技能是有加成的哦 其他主要技能是, 算法逻辑 设
    93 次阅读|没有评论
  • 1、 well.. If you want to use your code after the evaluation time has expired, you need to buy the IP core implemented in your programming - otherwise you won't be able to programm your FPGA. If your evalution period has not expired yet, this is just a reminder ;-)   2、
    144 次阅读|没有评论
  • specify  verilog延时 检查时序的方式之一是时序仿真,在仿真过程中计算与该模块相关的延迟值;之二是静态时序验证。 (1)延迟类型 ·分布延迟:在每个独立的元件基础上定义一种建模方式是将延迟值赋给独立的门,另一种是在单独的assign语句中指定延迟值。 ·集总延迟:定义在每个独立模
    112 次阅读|没有评论
  • 台积电28nm工艺提供了HP HKMG高性能、HPL HKMG低漏电、LP SION低成本、HPM  HKMG移动计算四种版本。虽然为客户提供了更多、更有针对性的选择,但开发和生产难度因此大大提高,也分散了原本就不充裕的产能。为了不再20nm工艺上重演悲剧,台积电已经决定改变做法,不再划分不同的工艺版本。 台积电在近日举行的技
    205 次阅读|没有评论
  • 一.tar命令          tar可以为文件和目录创建档案。利用tar,用户可以为某一特定文件创建档案(备份文件),也可以在档案中改变文件,或者向档案中加入新的文件。tar 最初被用来在磁带上创建档案,现在,用户可以在任何设备上创建档案,如软盘。利用tar命令,
    194 次阅读|没有评论