1 - 检测不到目标系统
        调试前，请把目标板连接好，然后用调试软件检测目标系统。如果检测不到目标系统，请做以下的检查。
        A - 有些芯片是可以加密的，加密后JTAG接口就自动被禁用掉了；
        B - 确定你的连接是正确的；
        C - 确定你使用的仿真器是被调试软件支持的
        D - 对WIGGLER而言，因为没有固定的电路图，所以需要在软件里做相应的设置；
        E - 对LPC2000系列而言，RTCK管脚一般是用来控制是否使能JTAG接口的，请查阅数据手册；
        F - 如果你用的芯片比较特殊，例如STR91X，因为内部扫描链是串接的，请设置好TAP，以让仿真
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1引 言

　　超声就是指频率高出可听频率极限(即在20 kHz以上的频段)的弹性振动，这种振动以波动形式在介质中的传播过程就形成超声波。超声波技术应用于流量测量的原理是：由超声换能器产生的超声波以某一角度入射到流体中，在流体中传播的超声波就载有流体流速的信息，利用接收到的超声波信号就可以测量流体的流速和流量。上世纪70年代以后，由于集成电路技术的迅猛发展，高性能、高稳定性的锁相技术的出现与应用，才使实用的超声波流量计得以迅速发展。超声波流量计结构简单，压力损失小，而且使用方便，因而得到了广泛的应用。

　　根据超声波声道结构类型可分为单声道和多声道超声波流量计；根据超声波流量计适用的流道不同可分为管道流量计、管渠流量计和河流流量计；根据对信号的检测原理，超声波流量计非接触测量方法分为：传播时差法、多普勒法、波束偏移法及流动超声法等不同类型，其中传播时差法又分为直接时差法、相位差法和频差法。双频超声波多普勒流量计能够产生两组异频、相互独立的超声波信号，两种频率用于识别和排除一系列的错误信号，他能有效去除噪声信号，并将准确识别出的多普勒信号进行平方放大。

　　本文给出了一种双频超声波流量计的硬件电路设计方法。

　　2总体的系统设计

　　互联网的带宽越来越大，基于互联网的信息特别是声音图像实时数据的传输已经成为可能。视频和音频数据的传输正好充分利用了互联网带宽，并达到了实时交流以及进行远程开会的可能。视频会议系统相比传统的电话会议更充分利用了互联网资源，从而降低了运营成本。

　　视频编码器是视频会议系统的主要构成部分。目前视频压缩标准有H.261、H.263、MPEG4和H.264等。新一代视频编码标准H.264与以往标准相比具有压缩率高，网络亲和性好，视频质量优越等优点。H.264引入了许多当前视频编码中的新技术，使得在相同的重建图像质量下，编码效率比H.263和MPEG-4高50％左右。
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为了因应市场对于较高性能、较小的系统尺寸及降低成本和电源的需求，系统设计者正将较高层级的混合信号功能整合在他们的系统单芯片（SoC）设计中。随着这些SoC设计上的混合信号组件数量增加了，基本的功能验证对于硅初期能否成功也愈来愈重要。FPGA在系统整合难题上加入了一个新特点，改善了系统整合面，如整体的系统成本、可靠性、可组态性、上市时间等。在核心上，此新范例－可编程系统单芯片（programmable system chip, PSC）整合FPGA电闸，内嵌快闪和模拟功能在单一的可程序化组件中，提供了具真正程序能力的理想低成本路径，而且系统设计者可以用来快速地设计和研发复杂的混合信号系统。

　　关键准则

　　如业界分析师所言，FPGA正成为现代高度整合的SoC系统选择的工具。原因很明显。由于硅架构是预先组装的，因此没有NRE成本，且任何可能影响产品性能或装置可靠度的制程变化都应已解决。芯片整体作业中大部分的复杂度（包括寄生RLC对时序的影响等）特性都已完整调整，且规格上的数据已考虑到这些。因此所有的验证循环都可以致力于设计的适当功能性上。下一个需要的是可以尽量减少特征化和强化设计功能性目标时间的验证方法。此项减少是透过组合智能型模型（抽出不会影响整体系统行为的较不重要细节）将所产生的模型置入已完全了解的流程中。

1、引言

　　六自由度电磁敏感定位系统作为一种新型的跟踪定位装置，可实时地确定目标的六个参数,已在机载火控系统（头盔瞄准具）、精密医疗器械、单兵作战模拟训练中获得广泛应用[1、2]。该跟踪系统由正弦信号发射电路、敏感信号接收电路组成的硬件和从敏感接收数据中求解目标参数的算法程序两部分组成，定位计算精度受制于上述两部分的误差。目前，在不考虑环境因素影响的情况下，算法误差已达到小于1毫弧的水平，因此，硬件电路的误差成为制约系统定位精度的主要因素。根据工作原理，该系统采取按时序依次激励发射天线，从而根据敏感天线接收信号组成接收矩阵计算目标参数。然而，作为时序控制电路的模拟器件，存在无法避免的温度漂移和时间漂移问题，从而大大影响了时序发射的精度，使系统定位计算的精度降低。为了解决该问题，本文利用CPLD数字控制技术对时序电路进行改进。CPLD(Complex Programmable Logic Device)是新一代的数字逻辑器件，具有速度快、集成度高、可靠性强、用户可重复编程或动态重构其逻辑功能等特点。利用CPLD芯片和数字控制技术设计的时序电路，可将时序控制的精度提高到纳秒级，并且工作稳定，不受温度的影响，有利于系统定位精度的提高。

　　2、系统原理[2、3]

在电子系统设计中，为了少走弯路和节省时间，应充分考虑并满足抗干扰性 的要求，避免在设计完成后再去进行抗干扰的补救措施。形成干扰的基本要素有三个：
（1）干扰源，指产生干扰的元件、设备或信号，用数学语言描述如下：du/dt， di/dt大的地方就是干扰源。如：雷电、继电器、可控硅、电机、高频时钟等都可 能成为干扰源。
（2）传播路径，指干扰从干扰源传播到敏感器件的通路或媒介。典型的干扰传 播路径是通过导线的传导和空间的辐射。
（3）敏感器件，指容易被干扰的对象。如：A/D、D/A变换器，单片机，数字IC， 弱信号放大器等。

一 电源线布置：
1、根据电流大小，尽量调宽导线布线。
2、电源线、地线的走向应与资料的传递方向一致。
3、在印制板的电源输入端应接上10~100μF的去耦电容。
二 地线布置：
1、数字地与模拟地分开。
2、接地线应尽量加粗，致少能通过3倍于印制板上的允许电流，一般应达2~3mm。
3、接地线应尽量构成死循环回路，这样可以减少地线电位差。
三 去耦电容配置：
1、印制板电源输入端跨接10~100μF的电解电容，若能大于100μF则更好。
2、每个集成芯片的Vcc和GND之间跨接一个0.01~0.1μF的陶瓷电容。如空间不允许，可为每4~10个芯片配置一个1~10μF的钽电容。
3、对抗噪能力弱，关断电流变化大的器件，以及ROM、RAM，应在Vcc和GND间接去耦电容。
4、在单片机复位端“RESET”上配以0.01μF的去耦电容。
5、去耦电容的引线不能太长，尤其是高频旁路电容不能带引线。
四 器件配置：
1、时钟发生器、晶振和CPU的时钟输入端应尽量靠近且远离其它低频器件。
2、小电流电路和大电流电路尽量远离逻辑电路。
3、印制板在机箱中的位置和方向，应保证发热量大的器件处在上方。
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