bjxiong 发表于 - 2007-12-11 14:41:00

1. Verilog中的module对应C++中的class。它们都可以实例化。例如可以写一个FullAdder module,表示全加器这种器件。


module FullAdder(a, b, cin, sum, cout);

input a, b, cin;

output sum, cout;

assign {cout, sum} = a + b + cin;

endmodule


然后在执行8-bit补码加减运算的ALU module中实例化8个FullAdder,表示ALU用到了8个FullAdder。

module ALU(a, b, result, cout, is_add);

input[7:0] a, b;

input is_add;

output[7:0] result;

output cout;

wire[7:0] b_not = ~b;


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bjxiong 发表于 - 2007-10-31 10:26:00

强!用集成电路手工打造CPU

    在如今越来越靠程序化、流水线作业来完成生产的制造业中,想找一件手工打造的产品,真是越来越难了。

    好在当今社会中,还是有一些强人在孜孜不倦的在完成着心中的“完美DIY”梦想。因此也使我们多了一些大开眼界、崇拜和向慕的机会。


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bjxiong 发表于 - 2007-8-24 10:43:00

1 Warning: VHDL Process Statement warning at random.vhd(18): signal reset is in statement, but is not in sensitivity list
 
----没把singal放到process()中

2 Warning: Found pins ing as undefined clocks and/or memory enables
Info: Assuming node CLK is an undefined clock
 
-=-----可能是说设计中产生的触发器没有使能端

3 Error: VHDL Interface Declaration error in clk_gen.vhd(29): interface object "clk_scan" of mode out cannot be read. Change object mode to buffer or inout.
  ------信号类型设置不对,out当作buffer来定义


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bjxiong 发表于 - 2007-8-23 16:02:00
        可编程逻辑领域正在发生翻天腹地的变化,可以预言今后几年的变化会更大,价钱越来越低,用的人越来越多。未来底层软件工程师将越来越少。这是因为FPGA正在蚕食CPU和DSP的市场以及芯片厂家的市场。未来的技术型小老板也会越来越多,因为你不需要积压很多资金就可以控制你的产品,你只需要关注你的FPGA卖出多少套。

        同时,现在的软件功能越来越强大:已经可以直接将C语言直接编程硬件描述语言Verilog/Vhdl。
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bjxiong 发表于 - 2007-8-23 15:49:00

Actel、Altera、Lattice Semiconductor和Xilinx是目前业界最主要的四大FPGA供应商,为了帮助中国的应用开发工程师更深入地了解FPGA的具体设计诀窍,我们特别邀请到了Altera系统应用工程部总监Greg Steinke、Xilinx综合方法经理Frederic Rivoallon、Xilinx高级技术市场工程师Philippe Garrault、Xilinx产品应用工程部高级经理Chris Stinson、Xilinx IP解决方案工程部总监Mike Frasier、Lattice Semiconductor应用工程部总监Bertrand Leigh和软件产品规划经理Mike Kendrick、Actel公司硅产品市场总监Martin Mason和应用高级经理Jonathan Alexander为大家传经授道。


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bjxiong 发表于 - 2007-8-23 15:42:00
我相信,以后的天下,必将是FPGA的!

任何一个从事后看来很成功的新事物从诞生到发展壮大都不可避免地经历过艰难的历程并可能成为被研究的案例,FPGA也不例外。1985年,当全球首款FPGA产品——XC2064诞生时,注定要使用大量芯片的PC机刚刚走出硅谷的实验室进入商业市场,因特网只是科学家和政府机构通信的神秘链路,无线电话笨重得像砖头,日后大红大紫的Bill Gates正在为生计而奋斗,创新的可编程产品似乎并没有什么用武之地。

  事实也的确如此。最初,FPGA只是用于胶合逻辑,从胶合逻辑到算法逻辑再到数字信号处理、高速串行收发器和嵌入式处理器,FPGA真正地从配角变成了主角。
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bjxiong 发表于 - 2007-8-21 11:21:00

方法1:在Altera网站上找NIOS II的文档。

 

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bjxiong 发表于 - 2007-8-21 11:10:00

1.Found clock-sensitive change during active clock edge at time
<time> on register "<name>"
原因:vector source file中时钟敏感信号(如:数据,允许端,清零,同步加
载等)在时钟的边缘同时变化。而时钟敏感信号是不能在时钟边沿变化的。其后
果为导致结果不正确。
措施:编辑vector source file

 

2.Verilog HDL assignment warning at <location>: truncated
with size <number> to match size of target (<number>


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bjxiong 发表于 - 2007-8-2 17:28:00

第一名 薄霭中的风车

这幅图是难得一见的一次雪地拍摄的照片,地上也蒙上了柔弱的白雾。凌晨的太阳是我们最好的伙伴,而远景中的小黑马当摄影记者靠近他时总想要咬记者!



第二名 孤山

Galapagos链岛最小的陆地之一。人们都叫它日落中被踢出的山岩!


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bjxiong 发表于 - 2007-8-2 16:51:00

        1你可以不拥有任何东西,除了对生活的激情。

  2然后是钱。

  3努力赚钱。

  4有了钱,可以拥有很多女人的身体。

  5没有钱,要拥有很多女人的心。

  6如果身体和心你都无法得到,那只能说明你的无能。

  7英雄和浪子,取长补短。

  8该英雄时要英雄,该浪子时得浪子。

  9喝酒,抽烟。一个都不能上瘾。

  10赌,女人,权力。追求,但不能沉沦。

  11热爱体育。如果你不热爱你就不是男人。

  12即使你爱体育爱得发疯。也不能抱着体育生活一辈子。


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